ES6101計(jì)算機(jī)組成原理信創(chuàng)實(shí)驗(yàn)開發(fā)平臺(tái)

所屬分類：電子信息技術(shù)

計(jì)算機(jī)組成原理信創(chuàng)實(shí)驗(yàn)開發(fā)平臺(tái)以國產(chǎn)中大規(guī)模FPGA為核心，配置撥碼開關(guān)/鍵盤等輸入單元、數(shù)碼管/液晶顯示屏等輸出單元

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產(chǎn)品詳情

1.產(chǎn)品介紹

計(jì)算機(jī)組成原理信創(chuàng)實(shí)驗(yàn)開發(fā)平臺(tái)以國產(chǎn)中大規(guī)模FPGA為核心，配置撥碼開關(guān)/鍵盤等輸入單元、數(shù)碼管/液晶顯示屏等輸出單元，以及串口、網(wǎng)口、顯示接口等接口單元，構(gòu)建計(jì)算機(jī)系統(tǒng)硬件平臺(tái)；用Digiblock圖形化編程方式和硬件描述語言實(shí)現(xiàn)計(jì)算機(jī)各組成部分，最終搭建以MIPS、RISC-V、Arm Cortex-M等自主可控CPU為核心的小型計(jì)算機(jī)系統(tǒng)。

通過Digiblock圖形化軟件仿真、虛實(shí)聯(lián)動(dòng)驗(yàn)證、硬件實(shí)現(xiàn)等步驟，循序漸進(jìn)地進(jìn)行原理驗(yàn)證、部件實(shí)現(xiàn)、系統(tǒng)設(shè)計(jì)，使學(xué)生不僅能理解計(jì)算機(jī)系統(tǒng)各部件的組成及工作原理，而且能掌握大規(guī)?？删幊踢壿嬈骷木幊淘O(shè)計(jì)方法，更有助于鍛煉、提升學(xué)生的計(jì)算機(jī)設(shè)計(jì)分析和系統(tǒng)實(shí)現(xiàn)能力。

支持《計(jì)算機(jī)組成原理》、《微機(jī)原理與接口技術(shù)》、《處理器體系結(jié)構(gòu)》、《嵌入式系統(tǒng)原理與設(shè)計(jì)》等課程的課程實(shí)驗(yàn)與課程設(shè)計(jì)，以及《計(jì)算機(jī)系統(tǒng)綜合設(shè)計(jì)》、《硬件描述語言與數(shù)字系統(tǒng)設(shè)計(jì)》、《微處理器綜合設(shè)計(jì)》等綜合實(shí)踐環(huán)節(jié)。

2、產(chǎn)品組成

計(jì)算機(jī)組成原理信創(chuàng)實(shí)驗(yàn)開發(fā)平臺(tái)硬件由中央處理器（CPU）、基本I/O單元、接口與外設(shè)單元、顯示屏等部分組成。

中央處理器以高云FPGA（現(xiàn)場(chǎng)可編程邏輯器件）為硬件平臺(tái)，可通過Digiblock圖形化編程方式和硬件描述語言實(shí)現(xiàn)多種類型的CPU，便于學(xué)生理解CPU各部分的組成及工作原理。

基本I/O單元包括撥碼開關(guān)/鍵盤等基礎(chǔ)輸入單元、數(shù)碼管/LED等基本輸出單元，便于學(xué)生調(diào)試程序、觀測(cè)CPU運(yùn)行狀態(tài)。

接口與外設(shè)單元包括多種高階接口和外設(shè)，學(xué)生可使用FPGA配合接口和外設(shè)單元實(shí)現(xiàn)完整的小型計(jì)算機(jī)系統(tǒng)。

觸控顯示屏可以顯示程序運(yùn)行結(jié)果，也可以作為人機(jī)接口，配合FPGA及接口和外設(shè)單元實(shí)現(xiàn)計(jì)算機(jī)應(yīng)用開發(fā)。

3、產(chǎn)品功能

關(guān)鍵詞：ES6101計(jì)算機(jī)組成原理信創(chuàng)實(shí)驗(yàn)開發(fā)平臺(tái)

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